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Thema: Kann Register nicht beschreiben - AFIO_MAPR - AF remap and debug I/O config register

Hybrid-Darstellung

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  1. #1
    Benutzer Stammmitglied
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    . . . @ Siro
    Alle andere Schnittstellen habe ich schon ausgeschaltet - kein Takt, keine Aktivierung.
    Remapp muss, leider, sein da nur über PB8 und PB9 CAN mit dem auf Board verhandenen CAN Transiver connected ist.

    Aus RM0008 - Reference manual, Seite 184 - 185
    ++++++++++++++++++++++++++++++++++++++++++++++++++ ++++++++++++++++++++
    Bits 14:13 CAN_REMAP[1:0]: CAN alternate function remapping
    These bits are set and cleared by software. They control the mapping of alternate functions
    CAN_RX and CAN_TX in devices with a single CAN interface.
    00: CAN_RX mapped to PA11, CAN_TX mapped to PA12
    01: Not used
    10: CAN_RX mapped to PB8, CAN_TX mapped to PB9 (not available on 36-pin package)
    ++++++++++++++++++++++++++++++++++++++++++++++++++ +++++++++++++++++++++

    - - - Aktualisiert - - -

    @ Ceos " . . . Zum einen scheint das Register WriteOnly zu sein, jedes zurücklesen wird also sinnlos sein."

    Laut "RM0008 - Reference manual, Seite 184 - 185" " . . . STM32F103xx, . . ." ist der Register "ReadWrite".

    NUR Read - hat Sinn aus meiner Sicht, . . . was für ein Sinn steckt daninter ein Register NUR Writable zu machen???
    Obwohl auch in diesem Reg. sind die SWJCFG Bits NUR Writable ???

    Klicke auf die Grafik für eine größere Ansicht

Name:	AFIO_MARP.jpg
Hits:	1
Größe:	67,6 KB
ID:	34033

  2. #2
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    Die Gründe sind sicher mannigfaltig, aber ja, es scheinen tatsächlich nur die Bits zu sein, also unwichtig für dein Problem ...

    bietet STM nicht üblicherweise auch ein Tool an mit dem man die Peripherie vorkonfigurieren kann?! Vielleicht findest du den notwendigen Trick in dem generierten Code?
    Es gibt 10 Sorten von Menschen: Die einen können binär zählen, die anderen
    nicht.

  3. #3
    Erfahrener Benutzer Roboter-Spezialist
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    Nur Schreiben macht wohl Sinn.
    zB Reset

    Gruß

  4. #4
    Benutzer Stammmitglied
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    . . . meinte - Nur Schreiben OHNE Lesen zu können ???
    Man kan schlecht Fehler im späteren Verlauf des Programms finden wenn man nicht weisst das die Befehle davor sauber funktionieren?

    Werd' mal davon ausgehen müssen das der ganzer AFIO_MAPR Register NUR Writable ist und versuche weiter zu gehen.

    Werde berichten wenn sich was ergibt.

  5. #5
    Benutzer Stammmitglied
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    . . . komme in der Sache nicht weiter.
    Im nächsten Schritt muss CAN initialisiert werden. Die notwendigen Register lassen sich beschreiben aber, die endgültige Initialisierung bleibt aus.
    Das Bit INAK (Initialization acknowledge) im Register ACAN_MCR muss von der Soft- und dann von Hardware = 0 gesetzt werden, tut es aber nicht.

    Bei Initialisierung "hört" CAN auf den Bus und muss sich synchronisieren.
    Ich glaube:
    - da die Rx und Tx NICH auf den Transmitter (PB8, PB9) umgeschaltet sind
    - und der CAN Transmitter an die CAN Hardware des Chips nicht angebunden ist
    kann CAN sich nicht "hören" und auch nicht synchronisieren.

    +++++++++++++++++++++++
    Bit 0 INAK: Initialization acknowledge
    This bit is set by hardware and indicates to the software that the CAN hardware is now in
    initialization mode. This bit acknowledges the initialization request from the software (set
    INRQ bit in CAN_MCR register).
    This bit is cleared by hardware when the CAN hardware has left the initialization mode (to
    be synchronized on the CAN bus). To be synchronized the hardware has to monitor a
    sequence of 11 consecutive recessive bits on the CAN RX signal.
    +++++++++++++++++++++++

    Also vermute ich mal - es ist quasi ein Folgefehler der AFIO-Geschichte . . .

  6. #6
    Benutzer Stammmitglied
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    Also - die Ursache war --- der veralteter Dibagger.
    Ein Arbeitskollege hat mir geholfen den GDB OpenOCD debugger zu installieren - jetzt läuft alles.

  7. #7
    Benutzer Stammmitglied
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    Hab gerade noch was gefunden zu den SWJ_CFG . . .

    ++++++++++++++++++++

    Bits 26:24 SWJ_CFG[2:0]: Serial wire JTAG configuration
    These bits are write-only (when read, the value is undefined). They are used to configure the
    SWJ and trace alternate function I/Os. The SWJ (Serial Wire JTAG) supports JTAG or SWD
    access to the Cortex® debug port. The default state after reset is SWJ ON without trace.
    This allows JTAG or SW mode to be enabled by sending a specific sequence on the JTMS /
    JTCK pin.
    000: Full SWJ (JTAG-DP + SW-DP): Reset State
    001: Full SWJ (JTAG-DP + SW-DP) but without NJTRST
    010: JTAG-DP Disabled and SW-DP Enabled
    100: JTAG-DP Disabled and SW-DP Disabled
    Other combinations: no effect
    ++++++++++++++++++++

    Kann die Einstellung dieser Bits was bewirken?

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